数字逻辑设计 求给出verilog程序 用case语句实现操作码的译码 输入a和b要求opcode为00 01 10 11时分别输出a/b a*b a+b a-b
来源:学生作业帮助网 编辑:作业帮 时间:2024/08/29 11:20:49
数字逻辑设计 求给出verilog程序 用case语句实现操作码的译码 输入a和b要求opcode为00 01 10 11时分别输出a/b a*b a+b a-b
数字逻辑设计 求给出verilog程序 用case语句实现操作码的译码 输入a和b
要求opcode为00 01 10 11时
分别输出a/b a*b a+b a-b
数字逻辑设计 求给出verilog程序 用case语句实现操作码的译码 输入a和b要求opcode为00 01 10 11时分别输出a/b a*b a+b a-b
module(opcode,a,b,c);
reg input [1:0]opcode;
reg output c;
always@(opcode)
begin
case(opcode)
2'b00 :c = a/b;
2'b01:c = a*b;
2'b10:c = a+b;
2'b11:c = a-b;
endcase
end
endmodule
数字逻辑设计 求给出verilog程序 用case语句实现操作码的译码 输入a和b要求opcode为00 01 10 11时分别输出a/b a*b a+b a-b
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